56c86c13ca
* #10 CGP Circuits as inputs (#11) * CGP Circuits as inputs * #10 support of signed output in general circuit * input as output works * output connected to input (c) * automated verilog testing * output rename * Implemented CSA and Wallace tree multiplier composing of CSAs. Also did some code cleanup. * Typos fix and code cleanup. * Added new (approximate) multiplier architectures and did some minor changes regarding sign extension for c output formats. * Updated automated testing scripts. * Small bugfix in python code generation (I initially thought this line is useless). * Updated generated circuits folder. Co-authored-by: Vojta Mrazek <mrazek@fit.vutbr.cz>
172 lines
9.9 KiB
Verilog
172 lines
9.9 KiB
Verilog
module u_dadda_cska4(input [3:0] a, input [3:0] b, output [7:0] u_dadda_cska4_out);
|
|
wire u_dadda_cska4_and_3_0;
|
|
wire u_dadda_cska4_and_2_1;
|
|
wire u_dadda_cska4_ha0_xor0;
|
|
wire u_dadda_cska4_ha0_and0;
|
|
wire u_dadda_cska4_and_3_1;
|
|
wire u_dadda_cska4_ha1_xor0;
|
|
wire u_dadda_cska4_ha1_and0;
|
|
wire u_dadda_cska4_and_2_0;
|
|
wire u_dadda_cska4_and_1_1;
|
|
wire u_dadda_cska4_ha2_xor0;
|
|
wire u_dadda_cska4_ha2_and0;
|
|
wire u_dadda_cska4_and_1_2;
|
|
wire u_dadda_cska4_and_0_3;
|
|
wire u_dadda_cska4_fa0_xor0;
|
|
wire u_dadda_cska4_fa0_and0;
|
|
wire u_dadda_cska4_fa0_xor1;
|
|
wire u_dadda_cska4_fa0_and1;
|
|
wire u_dadda_cska4_fa0_or0;
|
|
wire u_dadda_cska4_and_2_2;
|
|
wire u_dadda_cska4_and_1_3;
|
|
wire u_dadda_cska4_fa1_xor0;
|
|
wire u_dadda_cska4_fa1_and0;
|
|
wire u_dadda_cska4_fa1_xor1;
|
|
wire u_dadda_cska4_fa1_and1;
|
|
wire u_dadda_cska4_fa1_or0;
|
|
wire u_dadda_cska4_and_3_2;
|
|
wire u_dadda_cska4_fa2_xor0;
|
|
wire u_dadda_cska4_fa2_and0;
|
|
wire u_dadda_cska4_fa2_xor1;
|
|
wire u_dadda_cska4_fa2_and1;
|
|
wire u_dadda_cska4_fa2_or0;
|
|
wire u_dadda_cska4_and_0_0;
|
|
wire u_dadda_cska4_and_1_0;
|
|
wire u_dadda_cska4_and_0_2;
|
|
wire u_dadda_cska4_and_2_3;
|
|
wire u_dadda_cska4_and_0_1;
|
|
wire u_dadda_cska4_and_3_3;
|
|
wire u_dadda_cska4_u_cska6_xor0;
|
|
wire u_dadda_cska4_u_cska6_ha0_xor0;
|
|
wire u_dadda_cska4_u_cska6_ha0_and0;
|
|
wire u_dadda_cska4_u_cska6_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa0_xor0;
|
|
wire u_dadda_cska4_u_cska6_fa0_and0;
|
|
wire u_dadda_cska4_u_cska6_fa0_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa0_and1;
|
|
wire u_dadda_cska4_u_cska6_fa0_or0;
|
|
wire u_dadda_cska4_u_cska6_xor2;
|
|
wire u_dadda_cska4_u_cska6_fa1_xor0;
|
|
wire u_dadda_cska4_u_cska6_fa1_and0;
|
|
wire u_dadda_cska4_u_cska6_fa1_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa1_and1;
|
|
wire u_dadda_cska4_u_cska6_fa1_or0;
|
|
wire u_dadda_cska4_u_cska6_xor3;
|
|
wire u_dadda_cska4_u_cska6_fa2_xor0;
|
|
wire u_dadda_cska4_u_cska6_fa2_and0;
|
|
wire u_dadda_cska4_u_cska6_fa2_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa2_and1;
|
|
wire u_dadda_cska4_u_cska6_fa2_or0;
|
|
wire u_dadda_cska4_u_cska6_and_propagate00;
|
|
wire u_dadda_cska4_u_cska6_and_propagate01;
|
|
wire u_dadda_cska4_u_cska6_and_propagate02;
|
|
wire u_dadda_cska4_u_cska6_mux2to10_not0;
|
|
wire u_dadda_cska4_u_cska6_mux2to10_and1;
|
|
wire u_dadda_cska4_u_cska6_xor4;
|
|
wire u_dadda_cska4_u_cska6_fa3_xor0;
|
|
wire u_dadda_cska4_u_cska6_fa3_and0;
|
|
wire u_dadda_cska4_u_cska6_fa3_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa3_and1;
|
|
wire u_dadda_cska4_u_cska6_fa3_or0;
|
|
wire u_dadda_cska4_u_cska6_xor5;
|
|
wire u_dadda_cska4_u_cska6_fa4_xor0;
|
|
wire u_dadda_cska4_u_cska6_fa4_and0;
|
|
wire u_dadda_cska4_u_cska6_fa4_xor1;
|
|
wire u_dadda_cska4_u_cska6_fa4_and1;
|
|
wire u_dadda_cska4_u_cska6_fa4_or0;
|
|
wire u_dadda_cska4_u_cska6_and_propagate13;
|
|
wire u_dadda_cska4_u_cska6_mux2to11_and0;
|
|
wire u_dadda_cska4_u_cska6_mux2to11_not0;
|
|
wire u_dadda_cska4_u_cska6_mux2to11_and1;
|
|
wire u_dadda_cska4_u_cska6_mux2to11_xor0;
|
|
|
|
assign u_dadda_cska4_and_3_0 = a[3] & b[0];
|
|
assign u_dadda_cska4_and_2_1 = a[2] & b[1];
|
|
assign u_dadda_cska4_ha0_xor0 = u_dadda_cska4_and_3_0 ^ u_dadda_cska4_and_2_1;
|
|
assign u_dadda_cska4_ha0_and0 = u_dadda_cska4_and_3_0 & u_dadda_cska4_and_2_1;
|
|
assign u_dadda_cska4_and_3_1 = a[3] & b[1];
|
|
assign u_dadda_cska4_ha1_xor0 = u_dadda_cska4_ha0_and0 ^ u_dadda_cska4_and_3_1;
|
|
assign u_dadda_cska4_ha1_and0 = u_dadda_cska4_ha0_and0 & u_dadda_cska4_and_3_1;
|
|
assign u_dadda_cska4_and_2_0 = a[2] & b[0];
|
|
assign u_dadda_cska4_and_1_1 = a[1] & b[1];
|
|
assign u_dadda_cska4_ha2_xor0 = u_dadda_cska4_and_2_0 ^ u_dadda_cska4_and_1_1;
|
|
assign u_dadda_cska4_ha2_and0 = u_dadda_cska4_and_2_0 & u_dadda_cska4_and_1_1;
|
|
assign u_dadda_cska4_and_1_2 = a[1] & b[2];
|
|
assign u_dadda_cska4_and_0_3 = a[0] & b[3];
|
|
assign u_dadda_cska4_fa0_xor0 = u_dadda_cska4_ha2_and0 ^ u_dadda_cska4_and_1_2;
|
|
assign u_dadda_cska4_fa0_and0 = u_dadda_cska4_ha2_and0 & u_dadda_cska4_and_1_2;
|
|
assign u_dadda_cska4_fa0_xor1 = u_dadda_cska4_fa0_xor0 ^ u_dadda_cska4_and_0_3;
|
|
assign u_dadda_cska4_fa0_and1 = u_dadda_cska4_fa0_xor0 & u_dadda_cska4_and_0_3;
|
|
assign u_dadda_cska4_fa0_or0 = u_dadda_cska4_fa0_and0 | u_dadda_cska4_fa0_and1;
|
|
assign u_dadda_cska4_and_2_2 = a[2] & b[2];
|
|
assign u_dadda_cska4_and_1_3 = a[1] & b[3];
|
|
assign u_dadda_cska4_fa1_xor0 = u_dadda_cska4_fa0_or0 ^ u_dadda_cska4_and_2_2;
|
|
assign u_dadda_cska4_fa1_and0 = u_dadda_cska4_fa0_or0 & u_dadda_cska4_and_2_2;
|
|
assign u_dadda_cska4_fa1_xor1 = u_dadda_cska4_fa1_xor0 ^ u_dadda_cska4_and_1_3;
|
|
assign u_dadda_cska4_fa1_and1 = u_dadda_cska4_fa1_xor0 & u_dadda_cska4_and_1_3;
|
|
assign u_dadda_cska4_fa1_or0 = u_dadda_cska4_fa1_and0 | u_dadda_cska4_fa1_and1;
|
|
assign u_dadda_cska4_and_3_2 = a[3] & b[2];
|
|
assign u_dadda_cska4_fa2_xor0 = u_dadda_cska4_fa1_or0 ^ u_dadda_cska4_ha1_and0;
|
|
assign u_dadda_cska4_fa2_and0 = u_dadda_cska4_fa1_or0 & u_dadda_cska4_ha1_and0;
|
|
assign u_dadda_cska4_fa2_xor1 = u_dadda_cska4_fa2_xor0 ^ u_dadda_cska4_and_3_2;
|
|
assign u_dadda_cska4_fa2_and1 = u_dadda_cska4_fa2_xor0 & u_dadda_cska4_and_3_2;
|
|
assign u_dadda_cska4_fa2_or0 = u_dadda_cska4_fa2_and0 | u_dadda_cska4_fa2_and1;
|
|
assign u_dadda_cska4_and_0_0 = a[0] & b[0];
|
|
assign u_dadda_cska4_and_1_0 = a[1] & b[0];
|
|
assign u_dadda_cska4_and_0_2 = a[0] & b[2];
|
|
assign u_dadda_cska4_and_2_3 = a[2] & b[3];
|
|
assign u_dadda_cska4_and_0_1 = a[0] & b[1];
|
|
assign u_dadda_cska4_and_3_3 = a[3] & b[3];
|
|
assign u_dadda_cska4_u_cska6_xor0 = u_dadda_cska4_and_1_0 ^ u_dadda_cska4_and_0_1;
|
|
assign u_dadda_cska4_u_cska6_ha0_xor0 = u_dadda_cska4_and_1_0 ^ u_dadda_cska4_and_0_1;
|
|
assign u_dadda_cska4_u_cska6_ha0_and0 = u_dadda_cska4_and_1_0 & u_dadda_cska4_and_0_1;
|
|
assign u_dadda_cska4_u_cska6_xor1 = u_dadda_cska4_and_0_2 ^ u_dadda_cska4_ha2_xor0;
|
|
assign u_dadda_cska4_u_cska6_fa0_xor0 = u_dadda_cska4_and_0_2 ^ u_dadda_cska4_ha2_xor0;
|
|
assign u_dadda_cska4_u_cska6_fa0_and0 = u_dadda_cska4_and_0_2 & u_dadda_cska4_ha2_xor0;
|
|
assign u_dadda_cska4_u_cska6_fa0_xor1 = u_dadda_cska4_u_cska6_fa0_xor0 ^ u_dadda_cska4_u_cska6_ha0_and0;
|
|
assign u_dadda_cska4_u_cska6_fa0_and1 = u_dadda_cska4_u_cska6_fa0_xor0 & u_dadda_cska4_u_cska6_ha0_and0;
|
|
assign u_dadda_cska4_u_cska6_fa0_or0 = u_dadda_cska4_u_cska6_fa0_and0 | u_dadda_cska4_u_cska6_fa0_and1;
|
|
assign u_dadda_cska4_u_cska6_xor2 = u_dadda_cska4_ha0_xor0 ^ u_dadda_cska4_fa0_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa1_xor0 = u_dadda_cska4_ha0_xor0 ^ u_dadda_cska4_fa0_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa1_and0 = u_dadda_cska4_ha0_xor0 & u_dadda_cska4_fa0_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa1_xor1 = u_dadda_cska4_u_cska6_fa1_xor0 ^ u_dadda_cska4_u_cska6_fa0_or0;
|
|
assign u_dadda_cska4_u_cska6_fa1_and1 = u_dadda_cska4_u_cska6_fa1_xor0 & u_dadda_cska4_u_cska6_fa0_or0;
|
|
assign u_dadda_cska4_u_cska6_fa1_or0 = u_dadda_cska4_u_cska6_fa1_and0 | u_dadda_cska4_u_cska6_fa1_and1;
|
|
assign u_dadda_cska4_u_cska6_xor3 = u_dadda_cska4_ha1_xor0 ^ u_dadda_cska4_fa1_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa2_xor0 = u_dadda_cska4_ha1_xor0 ^ u_dadda_cska4_fa1_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa2_and0 = u_dadda_cska4_ha1_xor0 & u_dadda_cska4_fa1_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa2_xor1 = u_dadda_cska4_u_cska6_fa2_xor0 ^ u_dadda_cska4_u_cska6_fa1_or0;
|
|
assign u_dadda_cska4_u_cska6_fa2_and1 = u_dadda_cska4_u_cska6_fa2_xor0 & u_dadda_cska4_u_cska6_fa1_or0;
|
|
assign u_dadda_cska4_u_cska6_fa2_or0 = u_dadda_cska4_u_cska6_fa2_and0 | u_dadda_cska4_u_cska6_fa2_and1;
|
|
assign u_dadda_cska4_u_cska6_and_propagate00 = u_dadda_cska4_u_cska6_xor0 & u_dadda_cska4_u_cska6_xor2;
|
|
assign u_dadda_cska4_u_cska6_and_propagate01 = u_dadda_cska4_u_cska6_xor1 & u_dadda_cska4_u_cska6_xor3;
|
|
assign u_dadda_cska4_u_cska6_and_propagate02 = u_dadda_cska4_u_cska6_and_propagate00 & u_dadda_cska4_u_cska6_and_propagate01;
|
|
assign u_dadda_cska4_u_cska6_mux2to10_not0 = ~u_dadda_cska4_u_cska6_and_propagate02;
|
|
assign u_dadda_cska4_u_cska6_mux2to10_and1 = u_dadda_cska4_u_cska6_fa2_or0 & u_dadda_cska4_u_cska6_mux2to10_not0;
|
|
assign u_dadda_cska4_u_cska6_xor4 = u_dadda_cska4_and_2_3 ^ u_dadda_cska4_fa2_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa3_xor0 = u_dadda_cska4_and_2_3 ^ u_dadda_cska4_fa2_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa3_and0 = u_dadda_cska4_and_2_3 & u_dadda_cska4_fa2_xor1;
|
|
assign u_dadda_cska4_u_cska6_fa3_xor1 = u_dadda_cska4_u_cska6_fa3_xor0 ^ u_dadda_cska4_u_cska6_mux2to10_and1;
|
|
assign u_dadda_cska4_u_cska6_fa3_and1 = u_dadda_cska4_u_cska6_fa3_xor0 & u_dadda_cska4_u_cska6_mux2to10_and1;
|
|
assign u_dadda_cska4_u_cska6_fa3_or0 = u_dadda_cska4_u_cska6_fa3_and0 | u_dadda_cska4_u_cska6_fa3_and1;
|
|
assign u_dadda_cska4_u_cska6_xor5 = u_dadda_cska4_fa2_or0 ^ u_dadda_cska4_and_3_3;
|
|
assign u_dadda_cska4_u_cska6_fa4_xor0 = u_dadda_cska4_fa2_or0 ^ u_dadda_cska4_and_3_3;
|
|
assign u_dadda_cska4_u_cska6_fa4_and0 = u_dadda_cska4_fa2_or0 & u_dadda_cska4_and_3_3;
|
|
assign u_dadda_cska4_u_cska6_fa4_xor1 = u_dadda_cska4_u_cska6_fa4_xor0 ^ u_dadda_cska4_u_cska6_fa3_or0;
|
|
assign u_dadda_cska4_u_cska6_fa4_and1 = u_dadda_cska4_u_cska6_fa4_xor0 & u_dadda_cska4_u_cska6_fa3_or0;
|
|
assign u_dadda_cska4_u_cska6_fa4_or0 = u_dadda_cska4_u_cska6_fa4_and0 | u_dadda_cska4_u_cska6_fa4_and1;
|
|
assign u_dadda_cska4_u_cska6_and_propagate13 = u_dadda_cska4_u_cska6_xor4 & u_dadda_cska4_u_cska6_xor5;
|
|
assign u_dadda_cska4_u_cska6_mux2to11_and0 = u_dadda_cska4_u_cska6_mux2to10_and1 & u_dadda_cska4_u_cska6_and_propagate13;
|
|
assign u_dadda_cska4_u_cska6_mux2to11_not0 = ~u_dadda_cska4_u_cska6_and_propagate13;
|
|
assign u_dadda_cska4_u_cska6_mux2to11_and1 = u_dadda_cska4_u_cska6_fa4_or0 & u_dadda_cska4_u_cska6_mux2to11_not0;
|
|
assign u_dadda_cska4_u_cska6_mux2to11_xor0 = u_dadda_cska4_u_cska6_mux2to11_and0 ^ u_dadda_cska4_u_cska6_mux2to11_and1;
|
|
|
|
assign u_dadda_cska4_out[0] = u_dadda_cska4_and_0_0;
|
|
assign u_dadda_cska4_out[1] = u_dadda_cska4_u_cska6_ha0_xor0;
|
|
assign u_dadda_cska4_out[2] = u_dadda_cska4_u_cska6_fa0_xor1;
|
|
assign u_dadda_cska4_out[3] = u_dadda_cska4_u_cska6_fa1_xor1;
|
|
assign u_dadda_cska4_out[4] = u_dadda_cska4_u_cska6_fa2_xor1;
|
|
assign u_dadda_cska4_out[5] = u_dadda_cska4_u_cska6_fa3_xor1;
|
|
assign u_dadda_cska4_out[6] = u_dadda_cska4_u_cska6_fa4_xor1;
|
|
assign u_dadda_cska4_out[7] = u_dadda_cska4_u_cska6_mux2to11_xor0;
|
|
endmodule |