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.subckt mux2to1 d0=h_arrdiv16_fs224_xor0 d1=a[1] sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1210_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs225_xor1 d1=h_arrdiv16_mux2to1195_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1211_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs226_xor1 d1=h_arrdiv16_mux2to1196_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1212_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs227_xor1 d1=h_arrdiv16_mux2to1197_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1213_xor0
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.subckt mux2to1 d0=h_arrdiv16_fs228_xor1 d1=h_arrdiv16_mux2to1198_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1214_xor0
|
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.subckt mux2to1 d0=h_arrdiv16_fs229_xor1 d1=h_arrdiv16_mux2to1199_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1215_xor0
|
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.subckt mux2to1 d0=h_arrdiv16_fs230_xor1 d1=h_arrdiv16_mux2to1200_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1216_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs231_xor1 d1=h_arrdiv16_mux2to1201_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1217_xor0
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|
.subckt mux2to1 d0=h_arrdiv16_fs232_xor1 d1=h_arrdiv16_mux2to1202_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1218_xor0
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.subckt mux2to1 d0=h_arrdiv16_fs233_xor1 d1=h_arrdiv16_mux2to1203_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1219_xor0
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|
.subckt mux2to1 d0=h_arrdiv16_fs234_xor1 d1=h_arrdiv16_mux2to1204_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1220_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs235_xor1 d1=h_arrdiv16_mux2to1205_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1221_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs236_xor1 d1=h_arrdiv16_mux2to1206_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1222_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs237_xor1 d1=h_arrdiv16_mux2to1207_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1223_xor0
|
|
.subckt mux2to1 d0=h_arrdiv16_fs238_xor1 d1=h_arrdiv16_mux2to1208_xor0 sel=h_arrdiv16_fs239_or0 mux2to1_xor0=h_arrdiv16_mux2to1224_xor0
|
|
.subckt not_gate a=h_arrdiv16_fs239_or0 out=h_arrdiv16_not14
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.subckt fs a=a[0] b=b[0] bin=gnd fs_xor1=h_arrdiv16_fs240_xor0 fs_or0=h_arrdiv16_fs240_and0
|
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.subckt fs a=h_arrdiv16_mux2to1210_xor0 b=b[1] bin=h_arrdiv16_fs240_and0 fs_xor1=h_arrdiv16_fs241_xor1 fs_or0=h_arrdiv16_fs241_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1211_xor0 b=b[2] bin=h_arrdiv16_fs241_or0 fs_xor1=h_arrdiv16_fs242_xor1 fs_or0=h_arrdiv16_fs242_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1212_xor0 b=b[3] bin=h_arrdiv16_fs242_or0 fs_xor1=h_arrdiv16_fs243_xor1 fs_or0=h_arrdiv16_fs243_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1213_xor0 b=b[4] bin=h_arrdiv16_fs243_or0 fs_xor1=h_arrdiv16_fs244_xor1 fs_or0=h_arrdiv16_fs244_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1214_xor0 b=b[5] bin=h_arrdiv16_fs244_or0 fs_xor1=h_arrdiv16_fs245_xor1 fs_or0=h_arrdiv16_fs245_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1215_xor0 b=b[6] bin=h_arrdiv16_fs245_or0 fs_xor1=h_arrdiv16_fs246_xor1 fs_or0=h_arrdiv16_fs246_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1216_xor0 b=b[7] bin=h_arrdiv16_fs246_or0 fs_xor1=h_arrdiv16_fs247_xor1 fs_or0=h_arrdiv16_fs247_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1217_xor0 b=b[8] bin=h_arrdiv16_fs247_or0 fs_xor1=h_arrdiv16_fs248_xor1 fs_or0=h_arrdiv16_fs248_or0
|
|
.subckt fs a=h_arrdiv16_mux2to1218_xor0 b=b[9] bin=h_arrdiv16_fs248_or0 fs_xor1=h_arrdiv16_fs249_xor1 fs_or0=h_arrdiv16_fs249_or0
|
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.subckt fs a=h_arrdiv16_mux2to1219_xor0 b=b[10] bin=h_arrdiv16_fs249_or0 fs_xor1=h_arrdiv16_fs250_xor1 fs_or0=h_arrdiv16_fs250_or0
|
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.subckt fs a=h_arrdiv16_mux2to1220_xor0 b=b[11] bin=h_arrdiv16_fs250_or0 fs_xor1=h_arrdiv16_fs251_xor1 fs_or0=h_arrdiv16_fs251_or0
|
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.subckt fs a=h_arrdiv16_mux2to1221_xor0 b=b[12] bin=h_arrdiv16_fs251_or0 fs_xor1=h_arrdiv16_fs252_xor1 fs_or0=h_arrdiv16_fs252_or0
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.subckt fs a=h_arrdiv16_mux2to1222_xor0 b=b[13] bin=h_arrdiv16_fs252_or0 fs_xor1=h_arrdiv16_fs253_xor1 fs_or0=h_arrdiv16_fs253_or0
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.subckt fs a=h_arrdiv16_mux2to1223_xor0 b=b[14] bin=h_arrdiv16_fs253_or0 fs_xor1=h_arrdiv16_fs254_xor1 fs_or0=h_arrdiv16_fs254_or0
|
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.subckt fs a=h_arrdiv16_mux2to1224_xor0 b=b[15] bin=h_arrdiv16_fs254_or0 fs_xor1=h_arrdiv16_fs255_xor1 fs_or0=h_arrdiv16_fs255_or0
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.subckt not_gate a=h_arrdiv16_fs255_or0 out=h_arrdiv16_not15
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.names h_arrdiv16_not15 h_arrdiv16_out[0]
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1 1
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1 1
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1 1
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.end
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.model mux2to1
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.inputs d0 d1 sel
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.names vdd
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1
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.names gnd
|
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0
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.subckt and_gate a=d1 b=sel out=mux2to1_and0
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.subckt not_gate a=sel out=mux2to1_not0
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.subckt and_gate a=d0 b=mux2to1_not0 out=mux2to1_and1
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.subckt xor_gate a=mux2to1_and0 b=mux2to1_and1 out=mux2to1_xor0
|
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.end
|
|
|
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.model fs
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.inputs a b bin
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.names vdd
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1
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.names gnd
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0
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.subckt not_gate a=a out=fs_not0
|
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.subckt and_gate a=fs_not0 b=b out=fs_and0
|
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.subckt xor_gate a=bin b=fs_xor0 out=fs_xor1
|
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.subckt not_gate a=fs_xor0 out=fs_not1
|
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.subckt and_gate a=fs_not1 b=bin out=fs_and1
|
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.subckt or_gate a=fs_and1 b=fs_and0 out=fs_or0
|
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.end
|
|
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.model or_gate
|
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.inputs a b
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.outputs out
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.names vdd
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1
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.names gnd
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0
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1- 1
|
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-1 1
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.end
|
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.model and_gate
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.inputs a b
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.outputs out
|
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.names vdd
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1
|
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.names gnd
|
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0
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.names a b out
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11 1
|
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.end
|
|
|
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.model not_gate
|
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.inputs a
|
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.outputs out
|
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.names vdd
|
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1
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.names gnd
|
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0
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.names a out
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0 1
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.end
|
|
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.model xor_gate
|
|
.inputs a b
|
|
.outputs out
|
|
.names vdd
|
|
1
|
|
.names gnd
|
|
0
|
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.names a b out
|
|
01 1
|
|
10 1
|
|
.end
|