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Verilog
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Verilog
module u_dadda_cska4(input [3:0] a, input [3:0] b, output [7:0] u_dadda_cska4_out);
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wire u_dadda_cska4_and_3_0;
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wire u_dadda_cska4_and_2_1;
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wire u_dadda_cska4_ha0_xor0;
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wire u_dadda_cska4_ha0_and0;
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wire u_dadda_cska4_and_3_1;
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wire u_dadda_cska4_ha1_xor0;
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wire u_dadda_cska4_ha1_and0;
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wire u_dadda_cska4_and_2_0;
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wire u_dadda_cska4_and_1_1;
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wire u_dadda_cska4_ha2_xor0;
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wire u_dadda_cska4_ha2_and0;
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wire u_dadda_cska4_and_1_2;
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wire u_dadda_cska4_and_0_3;
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wire u_dadda_cska4_fa0_xor0;
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wire u_dadda_cska4_fa0_and0;
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wire u_dadda_cska4_fa0_xor1;
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wire u_dadda_cska4_fa0_and1;
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wire u_dadda_cska4_fa0_or0;
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wire u_dadda_cska4_and_2_2;
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wire u_dadda_cska4_and_1_3;
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wire u_dadda_cska4_fa1_xor0;
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wire u_dadda_cska4_fa1_and0;
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wire u_dadda_cska4_fa1_xor1;
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wire u_dadda_cska4_fa1_and1;
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wire u_dadda_cska4_fa1_or0;
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wire u_dadda_cska4_and_3_2;
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wire u_dadda_cska4_fa2_xor0;
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wire u_dadda_cska4_fa2_and0;
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wire u_dadda_cska4_fa2_xor1;
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wire u_dadda_cska4_fa2_and1;
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wire u_dadda_cska4_fa2_or0;
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wire u_dadda_cska4_and_0_0;
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wire u_dadda_cska4_and_1_0;
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wire u_dadda_cska4_and_0_2;
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wire u_dadda_cska4_and_2_3;
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wire u_dadda_cska4_and_0_1;
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wire u_dadda_cska4_and_3_3;
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wire u_dadda_cska4_u_cska6_xor0;
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wire u_dadda_cska4_u_cska6_ha0_xor0;
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wire u_dadda_cska4_u_cska6_ha0_and0;
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wire u_dadda_cska4_u_cska6_xor1;
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wire u_dadda_cska4_u_cska6_fa0_xor0;
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wire u_dadda_cska4_u_cska6_fa0_and0;
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wire u_dadda_cska4_u_cska6_fa0_xor1;
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wire u_dadda_cska4_u_cska6_fa0_and1;
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wire u_dadda_cska4_u_cska6_fa0_or0;
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wire u_dadda_cska4_u_cska6_xor2;
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wire u_dadda_cska4_u_cska6_fa1_xor0;
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wire u_dadda_cska4_u_cska6_fa1_and0;
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wire u_dadda_cska4_u_cska6_fa1_xor1;
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wire u_dadda_cska4_u_cska6_fa1_and1;
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wire u_dadda_cska4_u_cska6_fa1_or0;
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wire u_dadda_cska4_u_cska6_xor3;
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wire u_dadda_cska4_u_cska6_fa2_xor0;
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wire u_dadda_cska4_u_cska6_fa2_and0;
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wire u_dadda_cska4_u_cska6_fa2_xor1;
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wire u_dadda_cska4_u_cska6_fa2_and1;
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wire u_dadda_cska4_u_cska6_fa2_or0;
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wire u_dadda_cska4_u_cska6_and_propagate00;
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wire u_dadda_cska4_u_cska6_and_propagate01;
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wire u_dadda_cska4_u_cska6_and_propagate02;
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wire u_dadda_cska4_u_cska6_mux2to10_not0;
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wire u_dadda_cska4_u_cska6_mux2to10_and1;
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wire u_dadda_cska4_u_cska6_xor4;
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wire u_dadda_cska4_u_cska6_fa3_xor0;
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wire u_dadda_cska4_u_cska6_fa3_and0;
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wire u_dadda_cska4_u_cska6_fa3_xor1;
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wire u_dadda_cska4_u_cska6_fa3_and1;
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wire u_dadda_cska4_u_cska6_fa3_or0;
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wire u_dadda_cska4_u_cska6_xor5;
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wire u_dadda_cska4_u_cska6_fa4_xor0;
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wire u_dadda_cska4_u_cska6_fa4_and0;
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wire u_dadda_cska4_u_cska6_fa4_xor1;
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wire u_dadda_cska4_u_cska6_fa4_and1;
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wire u_dadda_cska4_u_cska6_fa4_or0;
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wire u_dadda_cska4_u_cska6_and_propagate13;
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wire u_dadda_cska4_u_cska6_mux2to11_and0;
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wire u_dadda_cska4_u_cska6_mux2to11_not0;
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wire u_dadda_cska4_u_cska6_mux2to11_and1;
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wire u_dadda_cska4_u_cska6_mux2to11_xor0;
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assign u_dadda_cska4_and_3_0 = a[3] & b[0];
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|
assign u_dadda_cska4_and_2_1 = a[2] & b[1];
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|
assign u_dadda_cska4_ha0_xor0 = u_dadda_cska4_and_3_0 ^ u_dadda_cska4_and_2_1;
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assign u_dadda_cska4_ha0_and0 = u_dadda_cska4_and_3_0 & u_dadda_cska4_and_2_1;
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|
assign u_dadda_cska4_and_3_1 = a[3] & b[1];
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|
assign u_dadda_cska4_ha1_xor0 = u_dadda_cska4_ha0_and0 ^ u_dadda_cska4_and_3_1;
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assign u_dadda_cska4_ha1_and0 = u_dadda_cska4_ha0_and0 & u_dadda_cska4_and_3_1;
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|
assign u_dadda_cska4_and_2_0 = a[2] & b[0];
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|
assign u_dadda_cska4_and_1_1 = a[1] & b[1];
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assign u_dadda_cska4_ha2_xor0 = u_dadda_cska4_and_2_0 ^ u_dadda_cska4_and_1_1;
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|
assign u_dadda_cska4_ha2_and0 = u_dadda_cska4_and_2_0 & u_dadda_cska4_and_1_1;
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|
assign u_dadda_cska4_and_1_2 = a[1] & b[2];
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assign u_dadda_cska4_and_0_3 = a[0] & b[3];
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assign u_dadda_cska4_fa0_xor0 = u_dadda_cska4_ha2_and0 ^ u_dadda_cska4_and_1_2;
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assign u_dadda_cska4_fa0_and0 = u_dadda_cska4_ha2_and0 & u_dadda_cska4_and_1_2;
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assign u_dadda_cska4_fa0_xor1 = u_dadda_cska4_fa0_xor0 ^ u_dadda_cska4_and_0_3;
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assign u_dadda_cska4_fa0_and1 = u_dadda_cska4_fa0_xor0 & u_dadda_cska4_and_0_3;
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assign u_dadda_cska4_fa0_or0 = u_dadda_cska4_fa0_and0 | u_dadda_cska4_fa0_and1;
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assign u_dadda_cska4_and_2_2 = a[2] & b[2];
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|
assign u_dadda_cska4_and_1_3 = a[1] & b[3];
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assign u_dadda_cska4_fa1_xor0 = u_dadda_cska4_fa0_or0 ^ u_dadda_cska4_and_2_2;
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assign u_dadda_cska4_fa1_and0 = u_dadda_cska4_fa0_or0 & u_dadda_cska4_and_2_2;
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assign u_dadda_cska4_fa1_xor1 = u_dadda_cska4_fa1_xor0 ^ u_dadda_cska4_and_1_3;
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|
assign u_dadda_cska4_fa1_and1 = u_dadda_cska4_fa1_xor0 & u_dadda_cska4_and_1_3;
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assign u_dadda_cska4_fa1_or0 = u_dadda_cska4_fa1_and0 | u_dadda_cska4_fa1_and1;
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assign u_dadda_cska4_and_3_2 = a[3] & b[2];
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|
assign u_dadda_cska4_fa2_xor0 = u_dadda_cska4_fa1_or0 ^ u_dadda_cska4_ha1_and0;
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|
assign u_dadda_cska4_fa2_and0 = u_dadda_cska4_fa1_or0 & u_dadda_cska4_ha1_and0;
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|
assign u_dadda_cska4_fa2_xor1 = u_dadda_cska4_fa2_xor0 ^ u_dadda_cska4_and_3_2;
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assign u_dadda_cska4_fa2_and1 = u_dadda_cska4_fa2_xor0 & u_dadda_cska4_and_3_2;
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assign u_dadda_cska4_fa2_or0 = u_dadda_cska4_fa2_and0 | u_dadda_cska4_fa2_and1;
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assign u_dadda_cska4_and_0_0 = a[0] & b[0];
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|
assign u_dadda_cska4_and_1_0 = a[1] & b[0];
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assign u_dadda_cska4_and_0_2 = a[0] & b[2];
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|
assign u_dadda_cska4_and_2_3 = a[2] & b[3];
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assign u_dadda_cska4_and_0_1 = a[0] & b[1];
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|
assign u_dadda_cska4_and_3_3 = a[3] & b[3];
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assign u_dadda_cska4_u_cska6_xor0 = u_dadda_cska4_and_1_0 ^ u_dadda_cska4_and_0_1;
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assign u_dadda_cska4_u_cska6_ha0_xor0 = u_dadda_cska4_and_1_0 ^ u_dadda_cska4_and_0_1;
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assign u_dadda_cska4_u_cska6_ha0_and0 = u_dadda_cska4_and_1_0 & u_dadda_cska4_and_0_1;
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assign u_dadda_cska4_u_cska6_xor1 = u_dadda_cska4_and_0_2 ^ u_dadda_cska4_ha2_xor0;
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assign u_dadda_cska4_u_cska6_fa0_xor0 = u_dadda_cska4_and_0_2 ^ u_dadda_cska4_ha2_xor0;
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assign u_dadda_cska4_u_cska6_fa0_and0 = u_dadda_cska4_and_0_2 & u_dadda_cska4_ha2_xor0;
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assign u_dadda_cska4_u_cska6_fa0_xor1 = u_dadda_cska4_u_cska6_fa0_xor0 ^ u_dadda_cska4_u_cska6_ha0_and0;
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assign u_dadda_cska4_u_cska6_fa0_and1 = u_dadda_cska4_u_cska6_fa0_xor0 & u_dadda_cska4_u_cska6_ha0_and0;
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assign u_dadda_cska4_u_cska6_fa0_or0 = u_dadda_cska4_u_cska6_fa0_and0 | u_dadda_cska4_u_cska6_fa0_and1;
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assign u_dadda_cska4_u_cska6_xor2 = u_dadda_cska4_ha0_xor0 ^ u_dadda_cska4_fa0_xor1;
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assign u_dadda_cska4_u_cska6_fa1_xor0 = u_dadda_cska4_ha0_xor0 ^ u_dadda_cska4_fa0_xor1;
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assign u_dadda_cska4_u_cska6_fa1_and0 = u_dadda_cska4_ha0_xor0 & u_dadda_cska4_fa0_xor1;
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assign u_dadda_cska4_u_cska6_fa1_xor1 = u_dadda_cska4_u_cska6_fa1_xor0 ^ u_dadda_cska4_u_cska6_fa0_or0;
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|
assign u_dadda_cska4_u_cska6_fa1_and1 = u_dadda_cska4_u_cska6_fa1_xor0 & u_dadda_cska4_u_cska6_fa0_or0;
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|
assign u_dadda_cska4_u_cska6_fa1_or0 = u_dadda_cska4_u_cska6_fa1_and0 | u_dadda_cska4_u_cska6_fa1_and1;
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assign u_dadda_cska4_u_cska6_xor3 = u_dadda_cska4_ha1_xor0 ^ u_dadda_cska4_fa1_xor1;
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assign u_dadda_cska4_u_cska6_fa2_xor0 = u_dadda_cska4_ha1_xor0 ^ u_dadda_cska4_fa1_xor1;
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assign u_dadda_cska4_u_cska6_fa2_and0 = u_dadda_cska4_ha1_xor0 & u_dadda_cska4_fa1_xor1;
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|
assign u_dadda_cska4_u_cska6_fa2_xor1 = u_dadda_cska4_u_cska6_fa2_xor0 ^ u_dadda_cska4_u_cska6_fa1_or0;
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|
assign u_dadda_cska4_u_cska6_fa2_and1 = u_dadda_cska4_u_cska6_fa2_xor0 & u_dadda_cska4_u_cska6_fa1_or0;
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|
assign u_dadda_cska4_u_cska6_fa2_or0 = u_dadda_cska4_u_cska6_fa2_and0 | u_dadda_cska4_u_cska6_fa2_and1;
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assign u_dadda_cska4_u_cska6_and_propagate00 = u_dadda_cska4_u_cska6_xor0 & u_dadda_cska4_u_cska6_xor2;
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assign u_dadda_cska4_u_cska6_and_propagate01 = u_dadda_cska4_u_cska6_xor1 & u_dadda_cska4_u_cska6_xor3;
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assign u_dadda_cska4_u_cska6_and_propagate02 = u_dadda_cska4_u_cska6_and_propagate00 & u_dadda_cska4_u_cska6_and_propagate01;
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assign u_dadda_cska4_u_cska6_mux2to10_not0 = ~u_dadda_cska4_u_cska6_and_propagate02;
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assign u_dadda_cska4_u_cska6_mux2to10_and1 = u_dadda_cska4_u_cska6_fa2_or0 & u_dadda_cska4_u_cska6_mux2to10_not0;
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assign u_dadda_cska4_u_cska6_xor4 = u_dadda_cska4_and_2_3 ^ u_dadda_cska4_fa2_xor1;
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assign u_dadda_cska4_u_cska6_fa3_xor0 = u_dadda_cska4_and_2_3 ^ u_dadda_cska4_fa2_xor1;
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assign u_dadda_cska4_u_cska6_fa3_and0 = u_dadda_cska4_and_2_3 & u_dadda_cska4_fa2_xor1;
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assign u_dadda_cska4_u_cska6_fa3_xor1 = u_dadda_cska4_u_cska6_fa3_xor0 ^ u_dadda_cska4_u_cska6_mux2to10_and1;
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|
assign u_dadda_cska4_u_cska6_fa3_and1 = u_dadda_cska4_u_cska6_fa3_xor0 & u_dadda_cska4_u_cska6_mux2to10_and1;
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|
assign u_dadda_cska4_u_cska6_fa3_or0 = u_dadda_cska4_u_cska6_fa3_and0 | u_dadda_cska4_u_cska6_fa3_and1;
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|
assign u_dadda_cska4_u_cska6_xor5 = u_dadda_cska4_fa2_or0 ^ u_dadda_cska4_and_3_3;
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|
assign u_dadda_cska4_u_cska6_fa4_xor0 = u_dadda_cska4_fa2_or0 ^ u_dadda_cska4_and_3_3;
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|
assign u_dadda_cska4_u_cska6_fa4_and0 = u_dadda_cska4_fa2_or0 & u_dadda_cska4_and_3_3;
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|
assign u_dadda_cska4_u_cska6_fa4_xor1 = u_dadda_cska4_u_cska6_fa4_xor0 ^ u_dadda_cska4_u_cska6_fa3_or0;
|
|
assign u_dadda_cska4_u_cska6_fa4_and1 = u_dadda_cska4_u_cska6_fa4_xor0 & u_dadda_cska4_u_cska6_fa3_or0;
|
|
assign u_dadda_cska4_u_cska6_fa4_or0 = u_dadda_cska4_u_cska6_fa4_and0 | u_dadda_cska4_u_cska6_fa4_and1;
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|
assign u_dadda_cska4_u_cska6_and_propagate13 = u_dadda_cska4_u_cska6_xor4 & u_dadda_cska4_u_cska6_xor5;
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|
assign u_dadda_cska4_u_cska6_mux2to11_and0 = u_dadda_cska4_u_cska6_mux2to10_and1 & u_dadda_cska4_u_cska6_and_propagate13;
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|
assign u_dadda_cska4_u_cska6_mux2to11_not0 = ~u_dadda_cska4_u_cska6_and_propagate13;
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|
assign u_dadda_cska4_u_cska6_mux2to11_and1 = u_dadda_cska4_u_cska6_fa4_or0 & u_dadda_cska4_u_cska6_mux2to11_not0;
|
|
assign u_dadda_cska4_u_cska6_mux2to11_xor0 = u_dadda_cska4_u_cska6_mux2to11_and0 ^ u_dadda_cska4_u_cska6_mux2to11_and1;
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|
assign u_dadda_cska4_out[0] = u_dadda_cska4_and_0_0;
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assign u_dadda_cska4_out[1] = u_dadda_cska4_u_cska6_ha0_xor0;
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|
assign u_dadda_cska4_out[2] = u_dadda_cska4_u_cska6_fa0_xor1;
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|
assign u_dadda_cska4_out[3] = u_dadda_cska4_u_cska6_fa1_xor1;
|
|
assign u_dadda_cska4_out[4] = u_dadda_cska4_u_cska6_fa2_xor1;
|
|
assign u_dadda_cska4_out[5] = u_dadda_cska4_u_cska6_fa3_xor1;
|
|
assign u_dadda_cska4_out[6] = u_dadda_cska4_u_cska6_fa4_xor1;
|
|
assign u_dadda_cska4_out[7] = u_dadda_cska4_u_cska6_mux2to11_xor0;
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endmodule |